synopsys 中文意思是什麼 - TerryL

Function simulation and timing verification adopt simulation tool vcs of synopsys inc, the logic synthesis tool and fpga programming tool adopt the quartus ... 英文→中文 中文→英文> 字典 英漢字典 synopsys的中文意思 synopsys 中文意思是什麼 英 美 澳 synopsys 解釋 辛諾普西斯軟體公司 synopsys例句 Thisdesignformvbcsystemadoptstop-downedacommondesignflow.Circuitdesignadoptsveriloghdlcodingdescription.Functionsimulationandtimingverificationadoptsimulationtoolvcsofsynopsysinc,thelogicsynthesistoolandfpgaprogrammingtooladoptthequartusiiofalterainc,andthefpgaadvicestratixiiep2s15. 該mvbc系統設計採用業界通用的自上而下的eda設計方法，電路邏輯實現採用veriloghdl硬體語言描述，功能和時序驗證的動態模擬採用synopsys公司的vcs，而邏輯綜合與fpga實現採用altera公司的集成開發環境quartusii軟體以及stratixiiep2s15的fpga器件。

Weusedifferentcommercialedatoolsinordertoachievebetterimplementationindifferentdesignphase,whichincludesiliconensembleofcadence,designcompileranddesignprimerofsynopsysandsoon. 在設計的不同階段使用了不同的主流eda工具進行輔助設計和驗證，包括synopsys公司的邏輯綜合工具designcompiler、靜態時序分析工具designprimer和cadence公司的自動布局布線工具siliconensemble等。

2.Timingsetup:loadsdc(synopsysdesignconstraint)file.Definetiminganalysisoptions. 2.在時序設置階段，加入了時序約束，使整個設計在時序啟動下完成。

Synopsys'sveraisoneofthemostmodernlanguagesdesignedspeciallyformakingtestbenches. 其中，synopsys公司的vera語言是專用於設計測試平臺的現代語言之一。

Afterevaluatingsynopsys'sformality,thepaperconstruestheflowandpracticalexperiencesinvideopost-processchip,andcomestotheconclusionthatstaticverificationreallyworks. 在簡單評價了synopsys公司的商用軟體formality之後，重點分析了在視頻后處理晶元項目中formality的應用流程和實際工作經驗，證明形式驗證的重要作用。

Then,anewdesignautomationmethodologyisputforwardwhichusesumlforspecification,systmecforsimulationandsynopsystools(cocentricsystemccompiler)forhardwaresynthesis.Themainfeatureofthismethodologyisitshighpossibilityofimplementation. 提出了一個基於uml系統描述的，systemc模擬驗證的，利用cocentricsystemccomplier進行硬體綜合的自動化設計方案，這個方案最大特點是可實現性強。

Exceptfordesignmethodologyandtechnique,somecomprehensiveexperimentsareperformed.Theseexperimentsusesomeedatools,includingfunctionalsimulationwithcadence'sverilogxl,logicsynthesiswithsynopsys'sdesigncompiler. 本文除了介紹的設計方法和設計技巧，還做了一些有益的實驗，使用到許多流行的eda工具，如cadence公司的verilog-xl、siliconensemble，synopsys公司的designcompiler、physicalcompiler等。

Then,weusesoftwarehspiceofsynopsystorealizetheinductormacromodel,andthecircuitsystemrespondingtohysteresismathematicmodelcanbedesignedwell,meantime,themethodofbuildingthemacromodellaytechnicalfoundationforothercircuitsdesignandthatsimulationresultsapproachtorealbehaveior. 然後，利用synopsys公司的電路模擬軟體hspice實現磁芯電感宏觀模型，完成了與整個磁滯數學模型相對應的電路系統的設計，為其它電路系統的設計，以及模擬結果更接近實際工作情況奠定了良好的技術基礎。

Cadenceandsynopsysedatoolsisappliedasdesigntoolsofthisdesign,andhavingfront-endsimulationwithverilog_xlofcadence,havingbackendapplicationsimulationwithhspiceofavanti.Afterdesignfinishedwehadtwicempwordersequence,andthetestresultofthesampleconformtotherequestofdesign. 本次設計是在cadence和synopsys等eda設計工具上完成的，並進行了前端的verilog_xl功能模擬驗證和後端hspice的器件模擬，在完成整個設計流程后先後進行了兩次mpw投片，其樣片的測試結果達到了設計要求。

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